From d1287555d6f794e688ca0b81276775b0523c6be9 Mon Sep 17 00:00:00 2001
From: Yang Liu <liuyang22@iscas.ac.cn>
Date: Sat, 12 Oct 2024 19:13:22 +0800
Subject: [PATCH] Fix Zvk tests (for #51)

---
 .github/workflows/build-and-test.yml |   3 +-
 Makefrag                             | 520 ++++-----------------------
 generator/insn.go                    |   5 +
 generator/insn_vdvs2uimm.go          |  12 +-
 generator/insn_vdvs2vs1.go           |  13 +-
 5 files changed, 102 insertions(+), 451 deletions(-)

diff --git a/.github/workflows/build-and-test.yml b/.github/workflows/build-and-test.yml
index eba7d1c..0cd3923 100644
--- a/.github/workflows/build-and-test.yml
+++ b/.github/workflows/build-and-test.yml
@@ -56,7 +56,8 @@ jobs:
           export PATH="${{ github.workspace }}/riscv/bin:$PATH"
           export RISCV="${{ github.workspace }}/riscv"
           make generate-stage1
-          make all -j4
+          make all -j4 --environment-overrides VLEN=256
+          make all -j4 --environment-overrides VLEN=128
 
       - name: Archive artifacts
         uses: actions/upload-artifact@v3
diff --git a/Makefrag b/Makefrag
index ec06cf5..fea556b 100644
--- a/Makefrag
+++ b/Makefrag
@@ -6,9 +6,6 @@ tests = \
   vaadd_vv-4 \
   vaadd_vv-5 \
   vaadd_vv-6 \
-  vaadd_vv-7 \
-  vaadd_vv-8 \
-  vaadd_vv-9 \
   vaadd_vx-0 \
   vaadd_vx-1 \
   vaadd_vx-10 \
@@ -24,14 +21,6 @@ tests = \
   vaadd_vx-2 \
   vaadd_vx-20 \
   vaadd_vx-21 \
-  vaadd_vx-22 \
-  vaadd_vx-23 \
-  vaadd_vx-24 \
-  vaadd_vx-25 \
-  vaadd_vx-26 \
-  vaadd_vx-27 \
-  vaadd_vx-28 \
-  vaadd_vx-29 \
   vaadd_vx-3 \
   vaadd_vx-4 \
   vaadd_vx-5 \
@@ -46,9 +35,6 @@ tests = \
   vaaddu_vv-4 \
   vaaddu_vv-5 \
   vaaddu_vv-6 \
-  vaaddu_vv-7 \
-  vaaddu_vv-8 \
-  vaaddu_vv-9 \
   vaaddu_vx-0 \
   vaaddu_vx-1 \
   vaaddu_vx-10 \
@@ -64,14 +50,6 @@ tests = \
   vaaddu_vx-2 \
   vaaddu_vx-20 \
   vaaddu_vx-21 \
-  vaaddu_vx-22 \
-  vaaddu_vx-23 \
-  vaaddu_vx-24 \
-  vaaddu_vx-25 \
-  vaaddu_vx-26 \
-  vaaddu_vx-27 \
-  vaaddu_vx-28 \
-  vaaddu_vx-29 \
   vaaddu_vx-3 \
   vaaddu_vx-4 \
   vaaddu_vx-5 \
@@ -81,30 +59,22 @@ tests = \
   vaaddu_vx-9 \
   vadc_vim-0 \
   vadc_vim-1 \
-  vadc_vim-2 \
   vadc_vvm-0 \
-  vadc_vvm-1 \
   vadc_vxm-0 \
   vadc_vxm-1 \
   vadc_vxm-2 \
-  vadc_vxm-3 \
   vadd_vi-0 \
   vadd_vi-1 \
   vadd_vi-2 \
   vadd_vi-3 \
-  vadd_vi-4 \
-  vadd_vi-5 \
   vadd_vv-0 \
   vadd_vv-1 \
-  vadd_vv-2 \
   vadd_vx-0 \
   vadd_vx-1 \
   vadd_vx-2 \
   vadd_vx-3 \
   vadd_vx-4 \
   vadd_vx-5 \
-  vadd_vx-6 \
-  vadd_vx-7 \
   vaeskf1_vi-0 \
   vaeskf1_vi-1 \
   vaeskf2_vi-0 \
@@ -113,30 +83,22 @@ tests = \
   vand_vi-1 \
   vand_vi-2 \
   vand_vi-3 \
-  vand_vi-4 \
-  vand_vi-5 \
   vand_vv-0 \
   vand_vv-1 \
-  vand_vv-2 \
   vand_vx-0 \
   vand_vx-1 \
   vand_vx-2 \
   vand_vx-3 \
   vand_vx-4 \
   vand_vx-5 \
-  vand_vx-6 \
-  vand_vx-7 \
   vandn_vv-0 \
   vandn_vv-1 \
-  vandn_vv-2 \
   vandn_vx-0 \
   vandn_vx-1 \
   vandn_vx-2 \
   vandn_vx-3 \
   vandn_vx-4 \
   vandn_vx-5 \
-  vandn_vx-6 \
-  vandn_vx-7 \
   vasub_vv-0 \
   vasub_vv-1 \
   vasub_vv-2 \
@@ -144,9 +106,6 @@ tests = \
   vasub_vv-4 \
   vasub_vv-5 \
   vasub_vv-6 \
-  vasub_vv-7 \
-  vasub_vv-8 \
-  vasub_vv-9 \
   vasub_vx-0 \
   vasub_vx-1 \
   vasub_vx-10 \
@@ -162,14 +121,6 @@ tests = \
   vasub_vx-2 \
   vasub_vx-20 \
   vasub_vx-21 \
-  vasub_vx-22 \
-  vasub_vx-23 \
-  vasub_vx-24 \
-  vasub_vx-25 \
-  vasub_vx-26 \
-  vasub_vx-27 \
-  vasub_vx-28 \
-  vasub_vx-29 \
   vasub_vx-3 \
   vasub_vx-4 \
   vasub_vx-5 \
@@ -184,9 +135,6 @@ tests = \
   vasubu_vv-4 \
   vasubu_vv-5 \
   vasubu_vv-6 \
-  vasubu_vv-7 \
-  vasubu_vv-8 \
-  vasubu_vv-9 \
   vasubu_vx-0 \
   vasubu_vx-1 \
   vasubu_vx-10 \
@@ -202,14 +150,6 @@ tests = \
   vasubu_vx-2 \
   vasubu_vx-20 \
   vasubu_vx-21 \
-  vasubu_vx-22 \
-  vasubu_vx-23 \
-  vasubu_vx-24 \
-  vasubu_vx-25 \
-  vasubu_vx-26 \
-  vasubu_vx-27 \
-  vasubu_vx-28 \
-  vasubu_vx-29 \
   vasubu_vx-3 \
   vasubu_vx-4 \
   vasubu_vx-5 \
@@ -218,7 +158,9 @@ tests = \
   vasubu_vx-8 \
   vasubu_vx-9 \
   vbrev8_v-0 \
+  vbrev8_v-1 \
   vbrev_v-0 \
+  vbrev_v-1 \
   vclmul_vv-0 \
   vclmul_vx-0 \
   vclmul_vx-1 \
@@ -226,13 +168,15 @@ tests = \
   vclmulh_vx-0 \
   vclmulh_vx-1 \
   vclz_v-0 \
+  vclz_v-1 \
   vcompress_vm-0 \
   vcpop_m-0 \
   vcpop_v-0 \
+  vcpop_v-1 \
   vctz_v-0 \
+  vctz_v-1 \
   vdiv_vv-0 \
   vdiv_vv-1 \
-  vdiv_vv-2 \
   vdiv_vx-0 \
   vdiv_vx-1 \
   vdiv_vx-2 \
@@ -240,11 +184,8 @@ tests = \
   vdiv_vx-4 \
   vdiv_vx-5 \
   vdiv_vx-6 \
-  vdiv_vx-7 \
-  vdiv_vx-8 \
   vdivu_vv-0 \
   vdivu_vv-1 \
-  vdivu_vv-2 \
   vdivu_vx-0 \
   vdivu_vx-1 \
   vdivu_vx-2 \
@@ -252,63 +193,87 @@ tests = \
   vdivu_vx-4 \
   vdivu_vx-5 \
   vdivu_vx-6 \
-  vdivu_vx-7 \
-  vdivu_vx-8 \
   vfadd_vf-0 \
   vfadd_vf-1 \
   vfadd_vf-2 \
   vfadd_vf-3 \
+  vfadd_vf-4 \
   vfadd_vv-0 \
+  vfadd_vv-1 \
   vfclass_v-0 \
+  vfclass_v-1 \
   vfcvt_f_x_v-0 \
+  vfcvt_f_x_v-1 \
   vfcvt_f_xu_v-0 \
+  vfcvt_f_xu_v-1 \
   vfcvt_rtz_x_f_v-0 \
+  vfcvt_rtz_x_f_v-1 \
   vfcvt_rtz_xu_f_v-0 \
+  vfcvt_rtz_xu_f_v-1 \
   vfcvt_x_f_v-0 \
+  vfcvt_x_f_v-1 \
   vfcvt_xu_f_v-0 \
+  vfcvt_xu_f_v-1 \
   vfdiv_vf-0 \
   vfdiv_vf-1 \
   vfdiv_vf-2 \
   vfdiv_vf-3 \
+  vfdiv_vf-4 \
   vfdiv_vv-0 \
+  vfdiv_vv-1 \
   vfirst_m-0 \
   vfmacc_vf-0 \
   vfmacc_vf-1 \
   vfmacc_vf-2 \
   vfmacc_vf-3 \
+  vfmacc_vf-4 \
   vfmacc_vv-0 \
+  vfmacc_vv-1 \
   vfmadd_vf-0 \
   vfmadd_vf-1 \
   vfmadd_vf-2 \
   vfmadd_vf-3 \
+  vfmadd_vf-4 \
   vfmadd_vv-0 \
+  vfmadd_vv-1 \
   vfmax_vf-0 \
   vfmax_vf-1 \
   vfmax_vf-2 \
   vfmax_vf-3 \
+  vfmax_vf-4 \
   vfmax_vv-0 \
+  vfmax_vv-1 \
   vfmerge_vfm-0 \
   vfmerge_vfm-1 \
+  vfmerge_vfm-2 \
   vfmin_vf-0 \
   vfmin_vf-1 \
   vfmin_vf-2 \
   vfmin_vf-3 \
+  vfmin_vf-4 \
   vfmin_vv-0 \
+  vfmin_vv-1 \
   vfmsac_vf-0 \
   vfmsac_vf-1 \
   vfmsac_vf-2 \
   vfmsac_vf-3 \
+  vfmsac_vf-4 \
   vfmsac_vv-0 \
+  vfmsac_vv-1 \
   vfmsub_vf-0 \
   vfmsub_vf-1 \
   vfmsub_vf-2 \
   vfmsub_vf-3 \
+  vfmsub_vf-4 \
   vfmsub_vv-0 \
+  vfmsub_vv-1 \
   vfmul_vf-0 \
   vfmul_vf-1 \
   vfmul_vf-2 \
   vfmul_vf-3 \
+  vfmul_vf-4 \
   vfmul_vv-0 \
+  vfmul_vv-1 \
   vfmv_f_s-0 \
   vfmv_s_f-0 \
   vfmv_v_f-0 \
@@ -324,70 +289,99 @@ tests = \
   vfnmacc_vf-1 \
   vfnmacc_vf-2 \
   vfnmacc_vf-3 \
+  vfnmacc_vf-4 \
   vfnmacc_vv-0 \
+  vfnmacc_vv-1 \
   vfnmadd_vf-0 \
   vfnmadd_vf-1 \
   vfnmadd_vf-2 \
   vfnmadd_vf-3 \
+  vfnmadd_vf-4 \
   vfnmadd_vv-0 \
+  vfnmadd_vv-1 \
   vfnmsac_vf-0 \
   vfnmsac_vf-1 \
   vfnmsac_vf-2 \
   vfnmsac_vf-3 \
+  vfnmsac_vf-4 \
   vfnmsac_vv-0 \
+  vfnmsac_vv-1 \
   vfnmsub_vf-0 \
   vfnmsub_vf-1 \
   vfnmsub_vf-2 \
   vfnmsub_vf-3 \
+  vfnmsub_vf-4 \
   vfnmsub_vv-0 \
+  vfnmsub_vv-1 \
   vfrdiv_vf-0 \
   vfrdiv_vf-1 \
   vfrdiv_vf-2 \
   vfrdiv_vf-3 \
+  vfrdiv_vf-4 \
   vfrec7_v-0 \
+  vfrec7_v-1 \
   vfredmax_vs-0 \
+  vfredmax_vs-1 \
   vfredmin_vs-0 \
+  vfredmin_vs-1 \
   vfredosum_vs-0 \
+  vfredosum_vs-1 \
   vfredusum_vs-0 \
+  vfredusum_vs-1 \
   vfrsqrt7_v-0 \
+  vfrsqrt7_v-1 \
   vfrsub_vf-0 \
   vfrsub_vf-1 \
   vfrsub_vf-2 \
   vfrsub_vf-3 \
+  vfrsub_vf-4 \
   vfsgnj_vf-0 \
   vfsgnj_vf-1 \
   vfsgnj_vf-2 \
   vfsgnj_vf-3 \
+  vfsgnj_vf-4 \
   vfsgnj_vv-0 \
+  vfsgnj_vv-1 \
   vfsgnjn_vf-0 \
   vfsgnjn_vf-1 \
   vfsgnjn_vf-2 \
   vfsgnjn_vf-3 \
+  vfsgnjn_vf-4 \
   vfsgnjn_vv-0 \
+  vfsgnjn_vv-1 \
   vfsgnjx_vf-0 \
   vfsgnjx_vf-1 \
   vfsgnjx_vf-2 \
   vfsgnjx_vf-3 \
+  vfsgnjx_vf-4 \
   vfsgnjx_vv-0 \
+  vfsgnjx_vv-1 \
   vfslide1down_vf-0 \
   vfslide1down_vf-1 \
   vfslide1down_vf-2 \
   vfslide1down_vf-3 \
+  vfslide1down_vf-4 \
   vfslide1up_vf-0 \
   vfslide1up_vf-1 \
   vfslide1up_vf-2 \
   vfslide1up_vf-3 \
+  vfslide1up_vf-4 \
   vfsqrt_v-0 \
+  vfsqrt_v-1 \
   vfsub_vf-0 \
   vfsub_vf-1 \
   vfsub_vf-2 \
   vfsub_vf-3 \
+  vfsub_vf-4 \
   vfsub_vv-0 \
+  vfsub_vv-1 \
   vfwadd_vf-0 \
   vfwadd_vf-1 \
+  vfwadd_vf-2 \
   vfwadd_vv-0 \
   vfwadd_wf-0 \
   vfwadd_wf-1 \
+  vfwadd_wf-2 \
   vfwadd_wv-0 \
   vfwcvt_f_f_v-0 \
   vfwcvt_f_x_v-0 \
@@ -398,26 +392,33 @@ tests = \
   vfwcvt_xu_f_v-0 \
   vfwmacc_vf-0 \
   vfwmacc_vf-1 \
+  vfwmacc_vf-2 \
   vfwmacc_vv-0 \
   vfwmsac_vf-0 \
   vfwmsac_vf-1 \
+  vfwmsac_vf-2 \
   vfwmsac_vv-0 \
   vfwmul_vf-0 \
   vfwmul_vf-1 \
+  vfwmul_vf-2 \
   vfwmul_vv-0 \
   vfwnmacc_vf-0 \
   vfwnmacc_vf-1 \
+  vfwnmacc_vf-2 \
   vfwnmacc_vv-0 \
   vfwnmsac_vf-0 \
   vfwnmsac_vf-1 \
+  vfwnmsac_vf-2 \
   vfwnmsac_vv-0 \
   vfwredosum_vs-0 \
   vfwredusum_vs-0 \
   vfwsub_vf-0 \
   vfwsub_vf-1 \
+  vfwsub_vf-2 \
   vfwsub_vv-0 \
   vfwsub_wf-0 \
   vfwsub_wf-1 \
+  vfwsub_wf-2 \
   vfwsub_wv-0 \
   vghsh_vv-0 \
   vid_v-0 \
@@ -456,7 +457,6 @@ tests = \
   vloxei64_v-0 \
   vloxei8_v-0 \
   vloxei8_v-1 \
-  vloxei8_v-2 \
   vloxseg2ei16_v-0 \
   vloxseg2ei16_v-1 \
   vloxseg2ei32_v-0 \
@@ -465,19 +465,13 @@ tests = \
   vloxseg2ei8_v-0 \
   vloxseg2ei8_v-1 \
   vloxseg3ei16_v-0 \
-  vloxseg3ei16_v-1 \
   vloxseg3ei32_v-0 \
-  vloxseg3ei32_v-1 \
   vloxseg3ei64_v-0 \
   vloxseg3ei8_v-0 \
-  vloxseg3ei8_v-1 \
   vloxseg4ei16_v-0 \
-  vloxseg4ei16_v-1 \
   vloxseg4ei32_v-0 \
-  vloxseg4ei32_v-1 \
   vloxseg4ei64_v-0 \
   vloxseg4ei8_v-0 \
-  vloxseg4ei8_v-1 \
   vloxseg5ei16_v-0 \
   vloxseg5ei32_v-0 \
   vloxseg5ei64_v-0 \
@@ -502,7 +496,6 @@ tests = \
   vlse64_v-1 \
   vlse8_v-0 \
   vlse8_v-1 \
-  vlse8_v-2 \
   vlseg2e16_v-0 \
   vlseg2e16ff_v-0 \
   vlseg2e32_v-0 \
@@ -560,44 +553,33 @@ tests = \
   vlseg8e8_v-0 \
   vlseg8e8ff_v-0 \
   vlsseg2e16_v-0 \
-  vlsseg2e16_v-1 \
   vlsseg2e32_v-0 \
-  vlsseg2e32_v-1 \
   vlsseg2e64_v-0 \
   vlsseg2e8_v-0 \
-  vlsseg2e8_v-1 \
   vlsseg3e16_v-0 \
-  vlsseg3e16_v-1 \
   vlsseg3e32_v-0 \
   vlsseg3e64_v-0 \
   vlsseg3e8_v-0 \
-  vlsseg3e8_v-1 \
   vlsseg4e16_v-0 \
-  vlsseg4e16_v-1 \
   vlsseg4e32_v-0 \
   vlsseg4e64_v-0 \
   vlsseg4e8_v-0 \
-  vlsseg4e8_v-1 \
   vlsseg5e16_v-0 \
   vlsseg5e32_v-0 \
   vlsseg5e64_v-0 \
   vlsseg5e8_v-0 \
-  vlsseg5e8_v-1 \
   vlsseg6e16_v-0 \
   vlsseg6e32_v-0 \
   vlsseg6e64_v-0 \
   vlsseg6e8_v-0 \
-  vlsseg6e8_v-1 \
   vlsseg7e16_v-0 \
   vlsseg7e32_v-0 \
   vlsseg7e64_v-0 \
   vlsseg7e8_v-0 \
-  vlsseg7e8_v-1 \
   vlsseg8e16_v-0 \
   vlsseg8e32_v-0 \
   vlsseg8e64_v-0 \
   vlsseg8e8_v-0 \
-  vlsseg8e8_v-1 \
   vluxei16_v-0 \
   vluxei16_v-1 \
   vluxei32_v-0 \
@@ -605,7 +587,6 @@ tests = \
   vluxei64_v-0 \
   vluxei8_v-0 \
   vluxei8_v-1 \
-  vluxei8_v-2 \
   vluxseg2ei16_v-0 \
   vluxseg2ei16_v-1 \
   vluxseg2ei32_v-0 \
@@ -614,19 +595,13 @@ tests = \
   vluxseg2ei8_v-0 \
   vluxseg2ei8_v-1 \
   vluxseg3ei16_v-0 \
-  vluxseg3ei16_v-1 \
   vluxseg3ei32_v-0 \
-  vluxseg3ei32_v-1 \
   vluxseg3ei64_v-0 \
   vluxseg3ei8_v-0 \
-  vluxseg3ei8_v-1 \
   vluxseg4ei16_v-0 \
-  vluxseg4ei16_v-1 \
   vluxseg4ei32_v-0 \
-  vluxseg4ei32_v-1 \
   vluxseg4ei64_v-0 \
   vluxseg4ei8_v-0 \
-  vluxseg4ei8_v-1 \
   vluxseg5ei16_v-0 \
   vluxseg5ei32_v-0 \
   vluxseg5ei64_v-0 \
@@ -645,271 +620,215 @@ tests = \
   vluxseg8ei8_v-0 \
   vmacc_vv-0 \
   vmacc_vv-1 \
-  vmacc_vv-2 \
   vmacc_vx-0 \
   vmacc_vx-1 \
   vmacc_vx-2 \
   vmacc_vx-3 \
   vmacc_vx-4 \
   vmacc_vx-5 \
-  vmacc_vx-6 \
-  vmacc_vx-7 \
   vmadc_vi-0 \
   vmadc_vi-1 \
-  vmadc_vi-2 \
   vmadc_vim-0 \
   vmadc_vim-1 \
-  vmadc_vim-2 \
   vmadc_vv-0 \
   vmadc_vvm-0 \
-  vmadc_vvm-1 \
   vmadc_vx-0 \
   vmadc_vx-1 \
   vmadc_vx-2 \
-  vmadc_vx-3 \
   vmadc_vxm-0 \
   vmadc_vxm-1 \
   vmadc_vxm-2 \
-  vmadc_vxm-3 \
   vmadd_vv-0 \
   vmadd_vv-1 \
-  vmadd_vv-2 \
   vmadd_vx-0 \
   vmadd_vx-1 \
   vmadd_vx-2 \
   vmadd_vx-3 \
   vmadd_vx-4 \
   vmadd_vx-5 \
-  vmadd_vx-6 \
-  vmadd_vx-7 \
   vmand_mm-0 \
   vmandn_mm-0 \
   vmax_vv-0 \
   vmax_vv-1 \
-  vmax_vv-2 \
   vmax_vx-0 \
   vmax_vx-1 \
   vmax_vx-2 \
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   vmax_vx-5 \
-  vmax_vx-6 \
-  vmax_vx-7 \
   vmaxu_vv-0 \
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   vsoxseg4ei32_v-0 \
   vsoxseg4ei64_v-0 \
   vsoxseg4ei8_v-0 \
-  vsoxseg4ei8_v-1 \
   vsoxseg5ei16_v-0 \
   vsoxseg5ei32_v-0 \
   vsoxseg5ei64_v-0 \
@@ -1421,47 +1203,33 @@ tests = \
   vsra_vi-0 \
   vsra_vi-1 \
   vsra_vi-2 \
-  vsra_vi-3 \
-  vsra_vi-4 \
   vsra_vv-0 \
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@@ -1494,11 +1262,6 @@ tests = \
   vssra_vi-1 \
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-  vssra_vi-16 \
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   vssra_vi-3 \
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@@ -1514,9 +1277,6 @@ tests = \
   vssra_vv-4 \
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   vssra_vv-6 \
-  vssra_vv-7 \
-  vssra_vv-8 \
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   vssra_vx-0 \
   vssra_vx-1 \
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@@ -1541,18 +1301,7 @@ tests = \
   vssra_vx-28 \
   vssra_vx-29 \
   vssra_vx-3 \
-  vssra_vx-30 \
-  vssra_vx-31 \
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-  vssra_vx-33 \
-  vssra_vx-34 \
-  vssra_vx-35 \
-  vssra_vx-36 \
-  vssra_vx-37 \
-  vssra_vx-38 \
-  vssra_vx-39 \
   vssra_vx-4 \
-  vssra_vx-40 \
   vssra_vx-5 \
   vssra_vx-6 \
   vssra_vx-7 \
@@ -1562,11 +1311,6 @@ tests = \
   vssrl_vi-1 \
   vssrl_vi-10 \
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-  vssrl_vi-12 \
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   vssrl_vi-3 \
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@@ -1582,9 +1326,6 @@ tests = \
   vssrl_vv-4 \
   vssrl_vv-5 \
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-  vssrl_vv-7 \
-  vssrl_vv-8 \
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   vssrl_vx-0 \
   vssrl_vx-1 \
   vssrl_vx-10 \
@@ -1609,18 +1350,7 @@ tests = \
   vssrl_vx-28 \
   vssrl_vx-29 \
   vssrl_vx-3 \
-  vssrl_vx-30 \
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@@ -1628,96 +1358,66 @@ tests = \
   vssrl_vx-9 \
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-  vssseg5e8_v-1 \
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-  vssseg7e16_v-1 \
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-  vssseg8e8_v-1 \
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   vssub_vv-1 \
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   vssub_vx-0 \
   vssub_vx-1 \
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   vssub_vx-2 \
   vssub_vx-3 \
   vssub_vx-4 \
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   vssub_vx-7 \
-  vssub_vx-8 \
-  vssub_vx-9 \
   vssubu_vv-0 \
   vssubu_vv-1 \
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   vssubu_vx-0 \
   vssubu_vx-1 \
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   vssubu_vx-2 \
   vssubu_vx-3 \
   vssubu_vx-4 \
   vssubu_vx-5 \
   vssubu_vx-6 \
   vssubu_vx-7 \
-  vssubu_vx-8 \
-  vssubu_vx-9 \
   vsub_vv-0 \
   vsub_vv-1 \
-  vsub_vv-2 \
   vsub_vx-0 \
   vsub_vx-1 \
-  vsub_vx-10 \
   vsub_vx-2 \
   vsub_vx-3 \
   vsub_vx-4 \
   vsub_vx-5 \
   vsub_vx-6 \
   vsub_vx-7 \
-  vsub_vx-8 \
-  vsub_vx-9 \
   vsuxei16_v-0 \
   vsuxei16_v-1 \
   vsuxei32_v-0 \
@@ -1728,22 +1428,17 @@ tests = \
   vsuxseg2ei16_v-0 \
   vsuxseg2ei16_v-1 \
   vsuxseg2ei32_v-0 \
-  vsuxseg2ei32_v-1 \
   vsuxseg2ei64_v-0 \
   vsuxseg2ei8_v-0 \
   vsuxseg2ei8_v-1 \
   vsuxseg3ei16_v-0 \
-  vsuxseg3ei16_v-1 \
   vsuxseg3ei32_v-0 \
   vsuxseg3ei64_v-0 \
   vsuxseg3ei8_v-0 \
-  vsuxseg3ei8_v-1 \
   vsuxseg4ei16_v-0 \
-  vsuxseg4ei16_v-1 \
   vsuxseg4ei32_v-0 \
   vsuxseg4ei64_v-0 \
   vsuxseg4ei8_v-0 \
-  vsuxseg4ei8_v-1 \
   vsuxseg5ei16_v-0 \
   vsuxseg5ei32_v-0 \
   vsuxseg5ei64_v-0 \
@@ -1761,147 +1456,88 @@ tests = \
   vsuxseg8ei64_v-0 \
   vsuxseg8ei8_v-0 \
   vwadd_vv-0 \
-  vwadd_vv-1 \
   vwadd_vx-0 \
   vwadd_vx-1 \
   vwadd_vx-2 \
-  vwadd_vx-3 \
-  vwadd_vx-4 \
   vwadd_wv-0 \
-  vwadd_wv-1 \
   vwadd_wx-0 \
   vwadd_wx-1 \
   vwadd_wx-2 \
-  vwadd_wx-3 \
-  vwadd_wx-4 \
   vwaddu_vv-0 \
-  vwaddu_vv-1 \
   vwaddu_vx-0 \
   vwaddu_vx-1 \
   vwaddu_vx-2 \
-  vwaddu_vx-3 \
-  vwaddu_vx-4 \
   vwaddu_wv-0 \
-  vwaddu_wv-1 \
   vwaddu_wx-0 \
   vwaddu_wx-1 \
   vwaddu_wx-2 \
-  vwaddu_wx-3 \
-  vwaddu_wx-4 \
   vwmacc_vv-0 \
-  vwmacc_vv-1 \
   vwmacc_vx-0 \
   vwmacc_vx-1 \
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   vwmaccsu_vv-0 \
-  vwmaccsu_vv-1 \
   vwmaccsu_vx-0 \
   vwmaccsu_vx-1 \
   vwmaccsu_vx-2 \
-  vwmaccsu_vx-3 \
-  vwmaccsu_vx-4 \
   vwmaccu_vv-0 \
-  vwmaccu_vv-1 \
   vwmaccu_vx-0 \
   vwmaccu_vx-1 \
   vwmaccu_vx-2 \
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   vwmaccus_vx-0 \
   vwmaccus_vx-1 \
   vwmaccus_vx-2 \
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   vwmul_vv-0 \
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   vwmulsu_vv-0 \
-  vwmulsu_vv-1 \
   vwmulsu_vx-0 \
   vwmulsu_vx-1 \
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-  vwmulsu_vx-4 \
-  vwmulsu_vx-5 \
-  vwmulsu_vx-6 \
   vwmulu_vv-0 \
-  vwmulu_vv-1 \
   vwmulu_vx-0 \
   vwmulu_vx-1 \
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   vwredsum_vs-0 \
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   vwredsumu_vs-0 \
-  vwredsumu_vs-1 \
   vwsll_vi-0 \
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   vwsubu_vx-1 \
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-  vwsubu_vx-4 \
   vwsubu_wv-0 \
-  vwsubu_wv-1 \
   vwsubu_wx-0 \
   vwsubu_wx-1 \
   vwsubu_wx-2 \
-  vwsubu_wx-3 \
-  vwsubu_wx-4 \
   vxor_vi-0 \
   vxor_vi-1 \
   vxor_vi-2 \
   vxor_vi-3 \
-  vxor_vi-4 \
-  vxor_vi-5 \
   vxor_vv-0 \
   vxor_vv-1 \
-  vxor_vv-2 \
   vxor_vx-0 \
   vxor_vx-1 \
   vxor_vx-2 \
   vxor_vx-3 \
   vxor_vx-4 \
   vxor_vx-5 \
-  vxor_vx-6 \
-  vxor_vx-7 \
   vzext_vf2-0 \
-  vzext_vf2-1 \
   vzext_vf4-0 \
   vzext_vf8-0 \
diff --git a/generator/insn.go b/generator/insn.go
index 86e7d74..c2ef8c8 100644
--- a/generator/insn.go
+++ b/generator/insn.go
@@ -61,6 +61,7 @@ type Insn struct {
 	Vxsat        bool       `toml:"vxsat"`
 	Tests        tests      `toml:"tests"`
 	Option       Option     `toml:"-"`
+	EGW          int        `toml:"-"`
 	TestData     *TestData
 }
 
@@ -237,6 +238,7 @@ func (i *Insn) genCodeCombinations(pos int) []string {
 func ReadInsnFromToml(contents []byte, option Option) (*Insn, error) {
 	i := Insn{
 		Option:   option,
+		EGW:      int(option.XLEN),
 		TestData: &TestData{},
 	}
 
@@ -491,6 +493,9 @@ csrci vxsat, 1
 func (i *Insn) combinations(lmuls []LMUL, sews []SEW, masks []bool, vxrms []VXRM) []combination {
 	res := make([]combination, 0)
 	for _, lmul := range lmuls {
+		if int(lmul)*int(i.Option.VLEN) < i.EGW {
+			continue
+		}
 		for _, sew := range sews {
 			if int(i.Option.XLEN) < int(sew) {
 				continue
diff --git a/generator/insn_vdvs2uimm.go b/generator/insn_vdvs2uimm.go
index 5bf0dc9..2129973 100644
--- a/generator/insn_vdvs2uimm.go
+++ b/generator/insn_vdvs2uimm.go
@@ -13,8 +13,13 @@ func (i *Insn) genCodeVdVs2Uimm(pos int) []string {
 	vs2Size := 1
 	vdSize := 1
 
+	if vsm3Insn {
+		i.EGW = 256
+	} else if sew32OnlyInsn {
+		i.EGW = 128
+	}
 	combinations := i.combinations(
-		iff(vsm3Insn, []LMUL{1, 2, 4, 8}, allLMULs),
+		allLMULs,
 		sews,
 		[]bool{false, true},
 		i.vxrms(),
@@ -22,10 +27,9 @@ func (i *Insn) genCodeVdVs2Uimm(pos int) []string {
 	res := make([]string, 0, len(combinations))
 
 	for _, c := range combinations[pos:] {
-		if sew32OnlyInsn && c.Vl%4 != 0 {
+		if sew32OnlyInsn {
 			c.Vl = (c.Vl + 3) &^ 3
-		}
-		if vsm3Insn {
+		} else if vsm3Insn {
 			c.Vl = (c.Vl + 7) &^ 7
 		}
 		builder := strings.Builder{}
diff --git a/generator/insn_vdvs2vs1.go b/generator/insn_vdvs2vs1.go
index f633c34..014e8ea 100644
--- a/generator/insn_vdvs2vs1.go
+++ b/generator/insn_vdvs2vs1.go
@@ -9,18 +9,23 @@ func (i *Insn) genCodeVdVs2Vs1(pos int) []string {
 	vsm3Insn := strings.HasPrefix(i.Name, "vsm3")
 	sew32OnlyInsn := strings.HasPrefix(i.Name, "vg") || strings.HasPrefix(i.Name, "vsha")
 	sews := iff(sew32OnlyInsn || vsm3Insn, []SEW{32}, allSEWs)
+	if vsm3Insn {
+		i.EGW = 256
+	} else if sew32OnlyInsn {
+		i.EGW = 128
+	}
 	combinations := i.combinations(
-		iff(vsm3Insn, []LMUL{1, 2, 4, 8}, allLMULs),
+		allLMULs,
 		sews,
 		[]bool{false},
 		i.vxrms(),
 	)
+
 	res := make([]string, 0, len(combinations))
 	for _, c := range combinations[pos:] {
-		if sew32OnlyInsn && c.Vl%4 != 0 {
+		if sew32OnlyInsn {
 			c.Vl = (c.Vl + 3) &^ 3
-		}
-		if vsm3Insn {
+		} else if vsm3Insn {
 			c.Vl = (c.Vl + 7) &^ 7
 		}
 		builder := strings.Builder{}